Governance del sign-off di tape-out per SVA sintetiche generate da AI
Proof Firewall ri-audita le asserzioni SystemVerilog sintetiche contrassegnate come PROVEN per vacuità, robustezza dell'asserzione e cono di influenza prima che entrino in un file di sign-off. Sulla scheda fissa, trasforma 8/8 prove di flusso bare-flow in cinque risultati certificati TRUSTWORTHY e instrada il resto a revisione umana con una motivazione. Gli agenti consigliano, il codice decide.
Da 8/8 a 5/8
Da PROVEN a TRUSTWORTHY
Scheda fissa sintetica a otto proprietà dopo l'audit del firewall
0/6
Kill di mutazione su PIPE3
Caso in evidenza della pipeline debole sintetica
18/18
Concordanza del benchmark sintetico etichettato
Benchmark di demo locale, non una rivendicazione di accuratezza in contesti aperti
Questa è una dimostrazione eseguibile e riproducibile che impiega progetti e proprietà di sistemi di transizione sintetici definiti da fixture. Non utilizza RTL dei clienti, un solver cloud o chiamate LLM in tempo reale sul percorso predefinito.
Il successo al primo silicio è stato riportato al 14% nello studio del 2024 di Wilson Research Group e Siemens EDA. Un risultato formale merita un esame più attento quando l'asserzione può essere generata da AI: un'implicazione può risultare PROVEN perché il suo antecedente non si verifica mai, o perché il suo conseguente non vincola nulla di utile.
Proof Firewall è un gate deterministico di governance post-prova per questa decisione. Non dichiara errato un motore formale. Si chiede se la prova sia sufficientemente difendibile da essere registrata per il sign-off umano di tape-out, lasciando quindi una motivazione concreta per ogni risultato certificato o trattenuto.
Il fulcro è la qualità della prova. Ciascun controllo deterministico verifica se una prova verde abbia sostanza sufficiente per essere registrata.
Il model checker a stati espliciti verifica se l'antecedente di un'implicazione possa verificarsi nell'IR del sistema di transizione sintetico. Un antecedente irraggiungibile viene instradato come VACUOUS invece di essere registrato come evidenza.
Mutazioni di progetto a singolo punto rilevanti verificano se l'asserzione respinge le varianti difettose. Una proprietà che sopravvive a tali mutazioni viene instradata come WEAK invece di poter prendere in prestito affidabilità da un risultato verde del solver.
Il gate calcola il cono di influenza e assegna TRUSTWORTHY, BOUNDED-PROVEN, VACUOUS, WEAK, DEAD o VIOLATED. Solo TRUSTWORTHY riceve un certificato dimostrativo firmato.
Il checker a stati espliciti in puro Python della demo individua tracce di raggiungibilità e controesempi nel modello finito. Un fallback a profondità limitata viene etichettato come bounded, non riformulato come prova incondizionata.
Ogni immagine è uno screenshot della demo sintetica in esecuzione. La scheda inizia come otto risultati bare-flow PROVEN, poi l'audit rende visibile l'evidenza trattenuta.
La Tape-Out Sign-Off Board mostra inizialmente 8/8 PROVEN nella sua vista bare-flow. Dopo l'audit del firewall, 5/8 sono certificate TRUSTWORTHY; le rimanenti tre sono una proprietà VACUOUS e due WEAK. Si tratta di una fixture sintetica fissa, non del progetto di un cliente o del risultato di un motore commerciale.
L'asserzione sintetica ARB3, assert (g0 && g1) |-> (turn == 0), è VACUOUS perché il suo antecedente è irraggiungibile nell'arbitro sintetico. Il risultato dimostra perché un'implicazione provata può comunque non certificare nulla.
L'asserzione sintetica PIPE3, assert v2 |-> (s2 == s2), è WEAK. Il suo conseguente tautologico sopravvive alle mutazioni rilevanti iniettate, e il caso di pipeline in evidenza registra 0/6 mutazioni eliminate.
La proprietà sintetica debole CDC2 è WEAK. Rafforzarla in assert (req && !ack) |-> ##1 req la rende VIOLATED sulla fixture CDC sintetica e produce una forma d'onda di controesempio concreta. Illustra una classe di guasto CDC con transazione persa, non un'affermazione su un chip reale.
Il certificato dimostrativo firmato registra per ciascuna proprietà verdetto, raggiungibilità, risultati delle mutazioni, COI e registri di controesempi ove applicabile, oltre a un campo SHA-256. Rende l'audit esaminabile senza richiedere a un revisore di dedurre il motivo per cui uno stato è cambiato.
Proof Firewall dimostra un gate attorno alle evidenze di prova. L'ambito sottostante separa ciò che la demo fa dal lavoro differito.
| Domanda | Demo di Proof Firewall | Direzione di produzione |
|---|---|---|
| Input di prova | IR del sistema di transizione sintetico e SVA definiti da fixture | Un gate attorno al flusso formale esistente del cliente |
| Controlli mostrati | Vacuità, test di eliminazione delle mutazioni, COI, instradamento delle policy, esportazione del certificato | Le stesse questioni di governance applicate alle evidenze di prova fornite |
| Motori formali | Nessun adapter per motori reali | Direzione agnostica rispetto al motore, non una rivendicazione di integrazione |
| Gestione dei risultati | Certificati TRUSTWORTHY e sospensioni motivate | Revisione umana del sign-off con un registro strutturato delle evidenze |
Un risultato PROVEN può comunque poggiare su un antecedente irraggiungibile o su una proprietà che non fallisce quando il comportamento di progetto rilevante è compromesso. Proof Firewall dimostra un gate deterministico post-prova per queste problematiche: raggiungibilità, test di eliminazione delle mutazioni, cono di influenza e instradamento delle policy. Non sostituisce un motore formale; la sua direzione di produzione è un gate agnostico rispetto al motore attorno a un flusso formale esistente.
No. Gli adapter per motori reali sono differiti in questa demo, pertanto non deve essere interpretata come un sostituto di JasperGold, VC Formal, Questa Formal, SymbiYosys o altri motori formali. La direzione di produzione dimostrata è un gate di governance agnostico rispetto al motore attorno al flusso di lavoro formale esistente del cliente.
No. La scheda, le asserzioni SystemVerilog, i progetti, il benchmark e i controesempi sono sintetici. Il percorso di registrazione predefinito utilizza proprietà SVA create da LLM e definite da fixture e un IR di sistema di transizione sintetico, non RTL dei clienti o chiamate LLM in tempo reale.
Si tratta di una scheda sintetica fissa a otto proprietà. La sua baseline bare-flow mostra 8/8 PROVEN; dopo l'audit del firewall, cinque sono certificate TRUSTWORTHY mentre una è VACUOUS e due sono WEAK. Non è una percentuale su RTL di produzione, un risultato di un cliente o un risultato generale per asserzioni sintetiche generate da AI.
Il gate di governance verifica se l'antecedente sia raggiungibile, esegue mutazioni di progetto a singolo punto rilevanti e calcola il cono di influenza di ciascuna proprietà. ARB3 è VACUOUS perché il suo antecedente è irraggiungibile nell'arbitro sintetico. PIPE3 è WEAK perché il suo conseguente tautologico sopravvive alle mutazioni rilevanti iniettate, con un risultato di eliminazione delle mutazioni di 0/6 nel caso di pipeline in evidenza.
L'interfaccia utente esporta signoff_certificate.json con i verdetti per proprietà, la raggiungibilità, i risultati delle mutazioni, il cono di influenza, i registri dei controesempi ove applicabile e un campo SHA-256. Solo TRUSTWORTHY riceve un certificato dimostrativo firmato; i risultati BOUNDED-PROVEN, VACUOUS, WEAK, DEAD e VIOLATED vengono trattenuti per la revisione umana con una motivazione.
La ricerca alla base di questa demo: l'architettura, il progetto di verifica e il blueprint aziendale.
Soluzione completa
Esplora la soluzione Semiconductor AI Verification & Silicon Correctness →Invitiamo i leader della verifica a confrontarsi sui percorsi di evidenza deterministici per i flussi di lavoro ingegneristici assistiti da AI ad alta posta in gioco.
La conversazione successiva più utile riguarda gli artefatti di prova che il tuo team deve esaminare, il confine di policy che un revisore può difendere e ciò che richiederebbe una direzione di produzione agnostica rispetto al motore.